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标签: 触发器
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- 边沿触发的D触发器只有在时钟信号为高电平时输出状态才会改变。
- 同步输入端的信号不需要等待时钟脉冲有效沿,可以直接影响触发器的状态。
- 时序逻辑电路通常包含组合逻辑电路和存储单元(触发器)两部分。
- 施密特触发器阈值电压之差称为()
- 同步D触发器在CP=1期间,D端输入信号变化时,对输出端Q的状态没有影响。
- 同步JK触发器在CP=1期间,J、K端输入信号发生变化时,输出端Q的状态像应发生变化。
- 边沿JK触发器在CP=1期间,J、K端输入信号变化时,对输出Q端状态没有影响。
- 边沿JK触发器在输入J=1,K=1时,时钟脉冲的频率为64kHz,则输出Q端的脉冲频率为32kHz。
- 由4个触发器构成的计数器,状态利用率最高的是()。
- 时序逻辑电路由触发器和组合逻辑电路组成。