FPGA/CPLD设计流程为：原理图/HDL文本输入→功能仿真→综合→适配→时序仿真→编程下载→硬件测试。
A.正确
B.错误
正确答案：正确
FPGACPLD设计流程为：原理图HDL文本输入→功能仿真→综合→适配→时序仿真→编程下载→硬件测试。
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